基于SRAM的存算一体架构研究
收藏国家基础学科公共科学数据中心2026-01-30 收录
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该数据集为基于SRAM的存算一体架构研究过程中产生的各种数据，包括了：基于存边处理器的目标识别系统、Neural Spike Sorting 处理器、icarus芯片设计、基于时域WTA电路的RRAM存算一体KNN加速器、基于chiplet的多芯片系统实时目标检测系统。本数据共包含12个文件。包括项目研发过程所设计芯片及原型系统的工程与代码，包含有Knight前端代码comb_rtl、Knight电路设计相关代码结构说明及代码、ICARUS前端设计代码、ICARUS单芯片&4芯片测试代码、基于时域WTA电路的RRAM存算一体KNN加速器数据、FP-CIM-based SLAM处理器数据、Neural Spike Sorting 处理器数据、基于PYNQ的目标识别代码、基板代码文件数据、FPGA 存算一体设计指令与脚本文件、ICARUS芯片后端.gds、ICARUSx4PCB设计文件。数据量为372.3MB。
提供机构：
复旦大学搜集汇总
数据集介绍
背景与挑战
背景概述
该数据集由复旦大学陈迟晓发布，聚焦于基于SRAM的存算一体架构研究，包含多种芯片设计、处理器原型及相关代码文件，共803个文件，数据量约684.07MB。
以上内容由遇见数据集搜集并总结生成
